别再只盯着增益了！聊聊折叠共源共栅运放设计中的‘权衡艺术’：摆幅、功耗与噪声的实战取舍

Iefex·2026-04-22·阅读 62 GEO检测（免费）

折叠共源共栅放大器运算放大器设计模拟电路CMOS

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折叠共源共栅运放设计的权衡艺术：从摆幅到噪声的系统级决策

在模拟电路设计的竞技场中，工程师们常常面临一个永恒的困境：如何在相互矛盾的性能指标间找到最佳平衡点？当我们把目光投向折叠共源共栅(Folded Cascode)运算放大器时，这种权衡变得尤为明显。与传统的套筒式结构相比，折叠结构提供了一种截然不同的设计哲学——它牺牲了部分增益和功耗效率，却换来了更大的信号摆幅和更灵活的偏置设计。这种取舍不是简单的技术选择，而是反映了深层次的系统级思维：在一个真实的电子系统中，没有任何单一参数能够决定整体性能，成功的设计总是各种因素精心调和的产物。

1. 结构选择的底层逻辑：为何折叠式成为现代设计的宠儿

1.1 从套筒式到折叠式的进化路径

套筒式共源共栅放大器曾经是高性能模拟电路的首选，其简洁的级联结构提供了出色的增益和频率特性。典型的套筒式结构增益可达：

code复制Av ≈ gm1 * (gm2 * ro2 * ro1)

但这种优雅的设计有一个致命弱点——受限的信号摆幅。在低电压设计中，这个问题被进一步放大。折叠结构的创新之处在于将直流路径"折叠"开来，通过引入额外的电流源分支，成功地将信号摆幅从原来的约2Vdsat提升到接近电源轨的水平。这种改进的代价是显而易见的：电流利用率降低约50%，噪声增加约√2倍，但这些牺牲在某些应用场景中完全值得。

1.2 关键参数对比实测数据

下表展示了0.18μm工艺下两种结构的典型性能对比：

参数	套筒式结构	折叠式结构	改进/代价
电压增益(dB)	72	65	-7dB
单位增益带宽(MHz)	120	85	-29%
输出摆幅(Vpp)	1.2	2.8	+133%

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