lee.2m1. AD9371/AD9375射频收发器架构解析
AD9371和AD9375是ADI公司推出的两款高度集成射频收发器芯片，它们在蜂窝通信、军用雷达、卫星通信等领域有着广泛应用。这两款芯片最大的特点是将传统需要多颗芯片才能实现的射频功能集成到单颗芯片中，包括混频器、滤波器、ADC/DAC、锁相环等关键模块。
我第一次接触AD9371是在一个5G小基站项目中，当时需要设计支持TDD和FDD双模的射频前端。相比传统分立方案，AD9371的集成度让我印象深刻——它在一个9mm×9mm的封装内集成了2个发射通道、2个接收通道、1个观测接收通道和3个嗅探接收通道。这种集成度不仅节省了PCB面积，更重要的是简化了系统校准流程。
AD9375在AD9371基础上增加了数字预失真(DPD)功能，这对于功放线性化特别重要。在实际测试中，我们发现AD9375的DPD可以将功放的ACLR指标改善10-15dB，这意味着功放可以工作在更高效率的区域。比如在2.6GHz频段测试时，功放效率从原来的8%提升到了15%，这对基站功耗的降低非常关键。
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2. JESD204B接口的硬件设计要点
JESD204B是AD9371/AD9375与FPGA通信的核心接口，采用高速串行链路传输数据。这个接口的设计质量直接影响整个系统的稳定性，我在多个项目中踩过不少坑，这里分享几个关键经验。
首先是时钟设计。JESD204B需要非常干净的参考时钟，相位噪声要优于-150dBc/Hz@1MHz。我们通常使用Silicon Labs的SI5345这类低噪声时钟芯片，配合良好的电源滤波电路。有一次项目中出现随机数据错误，最后发现是时钟电源的LC滤波电路Q值过高导致谐振，换成π型滤波后问题解决。
其次是PCB布线。JESD204B的SerDes速率可达6.144Gbps，这对PCB提出了很高要求。我们的经验是：
- 使用100Ω差分阻抗控制
- 走线长度匹配控制在5mil以内
- 避免穿过电源分割区域
- 在发送端串联33Ω电阻改善信号完整性
最后是同步设计。JESD204B子类1需要SYNC~信号进行链路同步。我们发现这个信号对抖动非常敏感，建议使用LVDS电平传输，并且走线要尽量短。有个项目因为这个信号受到干扰导致链路训练失败，后来在FPGA端增加了施密特触发器才解决问题。