孙秀龙1. 一个编译问题，卡了我两周
我在做嵌入式 AI 推理优化时遇到过一个非常典型的场景：算法同学给过来的模型在 GPU 上跑得很好，一搬到 NPU 上就各种"算子不支持""性能只有 GPU 的 1/10"。那段时间我几乎每天都在翻算子映射表和 IR dump 文件，最后发现问题的根源不在模型本身，而在于从深度学习框架到 NPU 底层指令之间，缺少一个能真正理解硬件特性的编译桥梁。
ATVOSS 就是冲着这个问题来的。它的核心定位很直接：在 TVM 这个开源编译框架和达芬奇架构（Da Vinci Architecture）之间，构建一条高性能、可扩展的编译通路。TVM 负责前端的图优化、算子融合、内存规划等高层工作，达芬奇架构负责实际的张量计算执行，但两者之间存在一个巨大的鸿沟——TVM 的 IR 设计面向的是通用硬件抽象，而达芬奇的 AI Core 有自己极其独特的流水线、buffer 层级和指令调度方式，不能简单地把 TVM 的中间表示丢给后端就完事。
这篇文章我想从架构设计的角度，把 ATVOSS 这条链路拆开讲。适合三类人看：一是正在做 TVM 或类 TVM 编译器后端适配的工程师，二是用昇腾系列硬件做推理部署、被自定义算子折磨过的开发者，三是对 AI 编译器整体架构感兴趣、想知道"从计算图到底层指令到底经历了什么"的学生或研究者。下面所有内容都基于我在实际项目中的工程实践和理解，不是官方文档的搬运。
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2. 为什么不能直接把 TVM 接到达芬奇架构上
2.1 TVM 后端的通用抽象，碰到达芬奇就失灵了
TVM 的架构设计是非常清晰的三段式：前端把 ONNX、PyTorch、TensorFlow 的计算图导入成 Relay IR，中端做高层次的图优化和图调度，后端再把优化后的 IR lower 到目标硬件。这套设计在 GPU、CPU、甚至一些通用 NPU 上都工作得很好，原因在于这些硬件的计算模型相对统一——GPU 是 SIMT 模型，CPU 是 SIMD 模型，本质上都是"大量线程/向量单元并行执行相同指令"。
但达芬奇架构不是这个路子。达芬奇的 AI Core 内部有 Cube 单元、Vector 单元和 Scalar 单元三个完全不同的计算通道：Cube 专门做矩阵乘累加，一个周期能塞进整块 16x16 甚至更大的矩阵；Vector 做逐元素和向量类计算；Scalar 处理标量和控制流。数据在这个三通道结构里流动时，要经过 L0、L1 两级 buffer 的层层搬运，每个 buffer 的容量、对齐规则、分配方式都完全不一样。
如果你把 TVM 默认生成的 TIR 直接跑到达芬奇上，最典型的问题就是算子被切得非常碎：原本一个 conv 加 bias 加 relu 的融合算子，在通用后端会被拆成多个独立的 kernel 依次执行，每个 kernel 启动都要重新加载权重、清空 buffer，性能和直接手写 TBE 算子差了不止一个数量级。
2.2 达芬奇架构执行模型的关键约束
要理解 ATVOSS 为什么必须做一堆定制化的东西，得先把达芬奇执行模型的核心约束说清楚。
第一个约束是数据流驱动的多级 buffer 结构。AI Core 内部的数据路径是：GM（Global Memory）→ L2 → L1 → L0A/L0B/L0C → 计算单元。矩阵运算时，A 矩阵和 B 矩阵分别要送到 L0A 和 L0B，结果累加到 L0C，然后再通过 Vector 单元做后续处理、搬回 GM。每一级搬运都有最小粒度限制，L0A/L0B 的单次搬运通常要求对齐到 32 字节甚至 64 字节，如果你分配的 buffer 大小不对齐，轻则性能骤降，重则直接报错。
第二个约束是Cube 和 Vector 的异步流水。在达芬奇上，Cube 做矩阵运算的时候 Vector 是可以同时做向量运算的，但这两条流水线之间同步完全靠指令依赖和 buffer 的空闲状态来管理。TVM 默认的调度机制并不知道这层关系，它只关心"数据的读写依赖"和"计算顺序"，不会主动去重叠 Cube 和 Vector 的执行，这在达芬奇上就是巨大的浪费。
第三个约束是指令格式的私有性。达芬奇的底层指令（比如矩阵计算指令、数据搬运指令、同步指令）是私有的，不开源，编译器后端只能通过官方提供的接口来生成指令序列。而 TVM 原生后端是需要直接发射指令或者调用底层库的，这里就出现了一个接口真空：TVM 的 codegen 不认达芬奇的指令，达芬奇的工具链也不认 TVM 的 TIR。
所以 ATVOSS 真正要解决的不是"优化优化调度策略"这么简单，它要做的是在两种完全不同的 IR 和运行时之间，建立一套语义映射、调度映射和资源映射的完整机制。这也是所有"给特定 NPU 做 TVM 后端"这类项目最难的地方——你写的不是一段适配代码，而是一个微型编译器。
3. ATVOSS 的架构分层：从 Relay 到二进制指令的完整通路
3.1 总体数据流：一条从计算图到 AI Core 的流水线
我看过一个比较清晰的 ATVOSS 架构描述，它在整体上把编译链路划分成了四个阶段，和 TVM 原生的流程很像，但每一层都针对达芬奇做了深度定制。
code复制前端框架（PyTorch / ONNX / TensorFlow）
↓ 算子解析与图构建
Relay IR（TVM 前端完成）
↓ 图优化 + 算子融合 + 布局转换
ATVOSS 中间表示层（Bridge IR）
↓ 算子映射 + tile 策略推导 + buffer 分配
达芬奇后端 Codegen（TBE / 私有指令生成）
↓ 编译 + 链接
昇腾运行时可执行文件
这里最值得注意的就是多出来的一层 Bridge IR。为什么不让 Relay 直接下到 TBE？因为 Relay 的算子树和达芬奇的算子指令之间完全不是一一对